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Lattice，8チャネルのSERDES回路とSONETの物理層/リンク層処理回路を内蔵するFPGAを発売
ニュース 2002年10月22日
米国Lattice Semiconductor社は，8チャネルのSERDES（serializer/de-serializer）回路とSONETの物理層/リンク層処理回路を内蔵するFPGA「ORSO 82G5」を発売した．1.0G～2.7Gbpsの伝送速度に対応する．FPGA部のシステム・ゲート数は40万．
プロトコル処理回路にはSONET処理とペイロード処理が含まれる．消費電力は1チャネル当たり210mW以下．信号の高周波成分を強調して伝送時の損失を補うプリエンファシスの機能を備えている．また，テストなどに利用できる疑似ランダム・ビット・ストリーム生成回路を内蔵している．FPGA部の動作周波数は最大250MHz．
電源電圧は1.5V．LVTTL，LVCMOS，GTL，GTL+，PECL，SSTL3/2，HSTL，ZBT，DDR，LVDS，bus-LVDL，LVPECLの入出力インターフェース規格に対応する．
ユーザは同社のPLD開発ツールである「ispLEVER」を使ってFPGA部の設計を行う．プロトコル処理回路のVHDL/Verilog HDLモデルや，ボード設計時に使用するノイズ解析用のSPICEモデルなども提供する．
[写真1] ORSO 82G5の外観
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