NECｴﾚｸﾄﾛﾆｸｽ,ｵｰﾃﾞｨ処理用CPUｺｱや画質調整回路を搭載したﾃﾞｨｼﾞﾀﾙ･ﾃﾚﾋﾞ向けLSIを発売
NECｴﾚｸﾄﾛﾆｸｽは,ﾃﾞｨｼﾞﾀﾙ･ﾃﾚﾋﾞ向けLSI｢EMMA2TH｣のｻﾝﾌﾟﾙ出荷を開始した．同社はこれまで,MPEGﾃﾞｺｰﾄﾞ機能や動画･静止画の表示機能,制御用CPUなどを搭載したﾃﾞｨｼﾞﾀﾙ･ﾃﾚﾋﾞ向けLSI｢EMMA2HL｣を出荷している．今回,ｵｰﾃﾞｨｵ処理専用のCPUｺｱや画質調整回路なども併せて集積した．日本のﾊｲﾋﾞｼﾞｮﾝ規格であるARIB(Association of Radio Industries and Businesses)と,北米のﾊｲﾋﾞｼﾞｮﾝ規格であるATSC(Advanced Television Systems Committee)に対応する．
本LSIは,合計四つのCPUｺｱを内蔵する．すなわち,ｱﾌﾟﾘｹｰｼｮﾝ･ｿﾌﾄｳｪｱやOSなどを実行するMIPS VR5500ﾌﾟﾛｾｯｻ･ｺｱ,ｼｽﾃﾑ制御(ﾌｧｰﾑｳｪｱ実行)用のMIPS32 4KEcﾌﾟﾛｾｯｻ･ｺｱ,および2個のｵｰﾃﾞｨ処理用CPUｺｱである．MIPS VR5500ﾌﾟﾛｾｯｻ･ｺｱの327MHz動作時の処理性能は654MIPS(million instructions per second),MIPS32 4KEcﾌﾟﾛｾｯｻ･ｺｱの196MHz動作時の処理性能は236MIPS．
複数の動画信号を同時にﾃﾞｺｰﾄﾞできる．例えば,BS放送と地上ﾃﾞｼﾞﾀﾙ放送の2放送を同時に受信することが可能．画質調整回路は,明るさやｺﾝﾄﾗｽﾄの調整,特別な色を強調する特色補正,3次元ﾉｲｽﾞ除去などの機能を備える．
ﾒﾓﾘ･ｲﾝﾀｰﾌｪｰｽとして,最大256Mﾊﾞｲﾄの容量に対応するDDR2ﾒﾓﾘ･ｲﾝﾀｰﾌｪｰｽと,最大64Mﾊﾞｲﾄに対応するﾌﾗｯｼｭROMｲﾝﾀｰﾌｪｰｽを搭載する．また,4ﾁｬﾈﾙのｽﾄﾘｰﾑ･ｲﾝﾀｰﾌｪｰｽを備えるMPEGﾄﾗﾝｽﾎﾟｰﾄ･ｽﾄﾘｰﾑ処理回路,MPEG-2 MP@HLに準拠するﾋﾞﾃﾞｵ･ﾃﾞｺｰﾄﾞ回路,MPEG-1/2 Audio Layer I/IIやMPEG-2 ACC(Advanced Audio Coding),SPDIF出力に対応するｵｰﾃﾞｨｵ制御回路,2次元BitBlt(ﾋﾞｯﾄﾏｯﾌﾟ･ﾌﾞﾛｯｸの高速転送処理)に対応するｸﾞﾗﾌｨｯｸｽ回路,256階調ｱﾙﾌｧ･ﾌﾞﾚﾝﾃﾞｨﾝｸﾞや画像の拡大･縮小などに対応する画像表示回路などを搭載する．さらに外部ｲﾝﾀｰﾌｪｰｽとして,32ﾋﾞｯﾄ幅,33MHz動作のPCIｲﾝﾀｰﾌｪｰｽ,SmartCardｲﾝﾀｰﾌｪｰｽ,I2Cｲﾝﾀｰﾌｪｰｽ,同期ｼﾘｱﾙ･ｲﾝﾀｰﾌｪｰｽ,各種ﾀｲﾏなどを内蔵する．
本LSIは,2007年4月〜5月に発表されたｿﾆｰの液晶ﾃﾞｨｽﾌﾟﾚｲ･ﾃﾚﾋﾞ｢BRAVIA｣に採用されている．
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