組み込みﾆｭｰｽ2006.2.10

MIPS,ﾏﾙﾁｽﾚｯﾄﾞ技術で性能を約60%向上させた32ﾋﾞｯﾄCPUｺｱを発売

　米国MIPS Technologies社は,ﾏﾙﾁｽﾚｯﾄﾞ技術を採用した組み込みｼｽﾃﾑ向け32ﾋﾞｯﾄCPUｺｱ｢MIPS32 34Kｺｱ･ﾌｧﾐﾘ｣を発売した．ﾏﾙﾁｽﾚｯﾄﾞ技術は,一つのCPU上で複数のｽﾚｯﾄﾞを並列に実行し,演算ﾘｿｰｽを有効活用する技術である．同社はこれを｢MIPS MT ASE(Application Specific Extention)｣と呼んでいる．例えば,ﾏﾙﾁｽﾚｯﾄﾞ技術を採用していない同社の24KEｺｱ･ﾌｧﾐﾘと比較すると,性能が約60%向上する．一方,ﾁｯﾌﾟ面積の増加は約14%にとどまるという．

　本CPUｺｱは,MIPS32 Release2命令ｾｯﾄ･ｱｰｷﾃｸﾁｬに準拠している．ﾊﾟｲﾌﾟﾗｲﾝ構成は9段．32ﾋﾞｯﾄ命令を16ﾋﾞｯﾄにｴﾝｺｰﾄﾞしてﾒﾓﾘ量を削減する｢MIPS16e｣,ﾕｰｻﾞ定義命令を追加できる｢CorExtend｣,DSP拡張命令｢MIPS DSP ASE｣などに対応している．

　ｵﾌﾟｼｮﾝとして,QoS(quality of service)機能を実現するﾎﾟﾘｼ･ﾏﾈｰｼﾞｬ,ｽﾚｯﾄﾞ間通信ﾕﾆｯﾄ,浮動小数点演算ﾕﾆｯﾄなどを用意する．QoS機能とは,つねにｽﾚｯﾄﾞの状態を監視し,各ﾀｽｸに対して必要な処理能力を割り当てていく機能である．

　すでに,米国iVivity社やｵﾗﾝﾀﾞMobileye社,米国PMC-Sierra社が本CPUｺｱのﾗｲｾﾝｽを受けているという．

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